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三位数字显示计时器设计电路图

数字逻辑电路设计要求设计一个三位数字显示的时间计数系统，供运动员比赛用。要求精确到秒，最大计时9分59秒。可以用按钮开关控制计时器的启动 停止 及清零，开机时可以自动清零。给出电路图，及个参数，和工作原理。
问 提问者：网友 2017-11-10
最佳回答
J0201-1型数字计时器，是根据教育部《JY36-79》号技术标准的规定和要求而设计的。主要供中等学校物理教学中进行演示实验使用。主要技术指标 1.在使用环境条件下，时基脉冲频率允许偏差0.5%。即1ms档为1000±5Hz;10ms档为100±1Hz。 2.计时范围分两档: 1ms档:0-0.999s; 10mS档:0-9.995。 读数误差允许最末一位数字±1。 ^^^^^^^^^^
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